星期四, 12月 28, 2006
星期二, 12月 26, 2006
星期二, 12月 12, 2006
1212第二階段
module top;
reg a,b,c,d;
wire a1,b1,c1,d1,f1,f2,f3,f4,f5,F;
nand q1(a1,a,a);
nand q2(b1,b,b);
nand q3(c1,c,c);
nand q4(d1,d,d);
nand q7(f1,a,b1,c);
nand q8(f2,a,c,d1);
nand q9(f3,a1,c1);
nand q10(f4,a1,b,c,d);
nand q6(f5,f4,f1,f2,f3);
nand q5(F,f5,f5,f5,f5);
initial
begin
a=0;b=0;c=0;d=0;
#1000 $finish;
end
always
#200 a=~a;
always
#100 b=~b;
always
#50 c=~c;
always
#25 d=~d;
endmodule
module top;
reg a,b,c,d;
wire a1,b1,c1,d1,f1,f2,f3,f4,f5,F;
nand #3 q1(a1,a,a);
nand #3 q2(b1,b,b);
nand #3 q3(c1,c,c);
nand #3 q4(d1,d,d);
nand #3 q7(f1,a,b1,c);
nand #3 q8(f2,a,c,d1);
nand #3 q9(f3,a1,c1);
nand #3 q10(f4,a1,b,c,d);
nand #3 q10(f4,a1,b,d);//去掉0_hazard
nand #3 q6(f5,f4,f1,f2,f3);
nand #3 q5(F,f5,f5,f5,f5);
initial
begin
a=0;b=1;c=0;d=1;
#1000 $finish;
end
always
#50 c=~c;
endmodule
星期二, 12月 05, 2006
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